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一文詳解頻率合成技術(shù)

FPGA設(shè)計(jì)論壇 ? 來(lái)源:CSDN技術(shù)社區(qū) ? 2025-05-20 14:05 ? 次閱讀
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一、直接模擬頻率合成技術(shù)

一般是以高穩(wěn)定度參考源比如晶振所產(chǎn)生的頻率信號(hào)作為基準(zhǔn),經(jīng)過(guò)必要的的加減乘除運(yùn)算(對(duì)不同信號(hào)混頻可以看作對(duì)相應(yīng)頻率的加減運(yùn)算,倍頻和分頻看作乘除運(yùn)算)得到需要的新的頻率,由于這樣產(chǎn)生的頻率是一系列離散的值,可以通過(guò)濾波器和開(kāi)關(guān)的選擇性提取出我們需要的指定輸出頻率,最后通過(guò)放大濾波電路輸出。直接模擬頻率合成技術(shù)屬于發(fā)展的早期階段,它的特點(diǎn)是較高分辨率和穩(wěn)定度,跳變頻時(shí)間短,但是也有因?qū)?a href="http://www.194w.cn/v/tag/167/" target="_blank">電路設(shè)計(jì)的高要求而產(chǎn)生的成本尺寸問(wèn)題。

二、直接數(shù)字頻率合成技術(shù)

基本思路

它首先是將波形的關(guān)鍵信息按已知邏輯置于芯片的集成寄存器中,通過(guò)控制信號(hào)可以有邏輯地讀取相應(yīng)的波形信息,再經(jīng)過(guò)數(shù)模變換和濾波放大等內(nèi)部集成的電路結(jié)構(gòu)就可以合成我們想要的信號(hào)。

對(duì)于 DDS 的整個(gè)原理過(guò)程進(jìn)行分析可知,將幅值相位等波形信息進(jìn)行存儲(chǔ)時(shí),從模擬到數(shù)字的過(guò)程避免不了數(shù)字量化誤差,這是導(dǎo)致相位失真和幅度失真的主要原因,其次,DDS 方案還存在雜散較大且不能消除、相位累加器截?cái)嗾`差、正弦查找表有限字長(zhǎng)和時(shí)鐘信號(hào)泄漏等問(wèn)題。它從波形信息單獨(dú)存儲(chǔ)提取的角度出發(fā),可以產(chǎn)生任意需要的波形和需要的初始相位,這種設(shè)計(jì)的靈活性也讓它可以在更廣闊的場(chǎng)景中發(fā)揮作用。

055d23a4-3220-11f0-afc8-92fbcf53809c.jpg

DDS 的基本原理框圖如上圖所示,從中看出,基本工作原理是邏輯控制產(chǎn)生的頻率碼控制累加器的一系列相位步進(jìn)并且對(duì)應(yīng)到相位信息,然后利用已知的存儲(chǔ)邏輯在 ROM 中找到對(duì)應(yīng)的幅度,接下來(lái)經(jīng)過(guò) DAC 模塊使信號(hào)的幅度成為階梯狀信號(hào),最終再低通濾波得到連續(xù)的正弦信號(hào)。

三、間接模擬式頻率源

間接模擬式頻率源的核心是模擬鎖相環(huán),它的頻率響應(yīng)時(shí)間比直接式的短得多,因?yàn)殒i相環(huán)等器件都有時(shí)延,另一方面,也是鎖相環(huán)類(lèi)似于窄帶濾波的特性會(huì)讓此方案的雜散較好,而架構(gòu)中的正弦鑒相器也會(huì)有效提升相噪指數(shù)。它的原理框圖如下圖,但也會(huì)有電路結(jié)構(gòu)復(fù)雜等限制它應(yīng)用的缺陷。

05717886-3220-11f0-afc8-92fbcf53809c.jpg

該類(lèi)頻率源方案的架構(gòu)中,晶振產(chǎn)生一個(gè)Lf 的基準(zhǔn)頻率,一路經(jīng)過(guò)倍頻后與壓控振蕩器的輸出信號(hào)進(jìn)行上變頻操作,實(shí)現(xiàn)壓控振蕩器輸出信號(hào)向高頻段的頻譜搬移,另一路則是以初始晶振得到的信號(hào)作為參考,在邏輯控制下與目標(biāo)信號(hào)進(jìn)行同頻鑒相,最終讓壓控振蕩器與晶振輸出信號(hào)的相位保持一致,達(dá)到鎖定狀態(tài)。架構(gòu)中的倍頻和混頻操作只是為實(shí)現(xiàn)高頻 VCO 的目標(biāo),不是必要模塊。

四、間接數(shù)字式頻率源

它的核心是數(shù)字鎖相環(huán),電路結(jié)構(gòu)方面加入了數(shù)字分頻器。特點(diǎn)是是頻率分辨

率高,易于集成等,因此通信系統(tǒng)中發(fā)揮著重要的作用,主要缺陷是相位噪聲差。

05810e36-3220-11f0-afc8-92fbcf53809c.jpg

間接數(shù)字式頻率綜合器的結(jié)構(gòu)如上圖所示,從中可以看到,先對(duì)壓控振蕩器的輸出頻率被進(jìn)行N分頻,再經(jīng)過(guò)反饋回路與用于參考的基準(zhǔn)頻率比較相位和頻率等信息,二者之間的差異直接影響誤差電壓信號(hào)使 VCO 頻率重新鎖定到目標(biāo)頻率的信號(hào)輸出。

五、鎖相環(huán)頻率合成技術(shù)

鎖相環(huán)合成技術(shù)核心是相位控制機(jī)制的鎖相環(huán),之前已經(jīng)有了一定介紹。具體而言分為整數(shù)分頻和小數(shù)分頻頻率合成技術(shù),其中常用的小數(shù)分頻頻率合成技術(shù)又分為脈沖移除技術(shù)和雙模分頻技術(shù)。

整數(shù)分頻頻率合成技術(shù)是在鎖相環(huán)的反饋回路中增加了一個(gè)分頻器,工作機(jī)制區(qū)別不大,由于分頻器的作用使輸出信號(hào) fo與輸入信號(hào) fi 頻率不再相等,而是變?yōu)楣潭ū戎?N,即: fo=N?fi。

利用鎖相環(huán)路可以快速調(diào)節(jié)重新鎖定的特點(diǎn),目前應(yīng)用廣泛的是程序控制 N 來(lái)實(shí)現(xiàn)鎖相環(huán)輸出信號(hào) fo 在壓控振蕩器的輸出范圍內(nèi)掃頻輸出。

整數(shù)分頻技術(shù)設(shè)計(jì)的系統(tǒng)能夠輸出的最精細(xì)頻率步進(jìn)就是鑒相頻率 fi ,因此對(duì)同一輸出頻率,提高其頻率分辨率只有增大分頻比 N,但這樣也會(huì)使鎖相環(huán)系統(tǒng)的相位噪聲惡化,相比較而言小數(shù)分頻技術(shù)可以在保持內(nèi)部鑒相頻率不變的前提下有效提升輸出信號(hào)的頻率分辨率性能,在高分辨率頻率源的設(shè)計(jì)中更為適用。小數(shù)分頻中脈沖移除技術(shù)是在整數(shù)分頻的電路結(jié)構(gòu)基礎(chǔ)上又在鎖相環(huán)反饋環(huán)路加入一個(gè)脈沖移除器,它可以按照特定的周期移除信號(hào)中的脈沖,脈沖移除技術(shù)進(jìn)一步發(fā)展形成了雙模分頻技術(shù)。

六、混合頻率合成技術(shù)

上述幾種單一類(lèi)型的頻率合成技術(shù)方案都有自己比較明顯的優(yōu)缺點(diǎn),所以目前頻率合成方案都會(huì)將直接和間接,數(shù)字和模擬,鎖相環(huán)頻率合成等多種頻率合成技術(shù)結(jié)合起來(lái),盡可能保留各自的優(yōu)勢(shì),避免較為明顯的缺陷,綜合形成混合頻率合成技術(shù)方案。

這樣可以實(shí)現(xiàn)單種頻率合成技術(shù)達(dá)不到的綜合性能指標(biāo)?,F(xiàn)今混合頻率合成方案已經(jīng)發(fā)展地較為完善,這里主要討論一下多環(huán)鎖相,DDS 激勵(lì)鎖相環(huán),PLL 和DDS 環(huán)內(nèi)和環(huán)外混頻這四種。

多環(huán)鎖相結(jié)構(gòu)相比于單環(huán)在頻率分辨率方面有明顯的提升,如下圖所示:

0590c272-3220-11f0-afc8-92fbcf53809c.jpg

輸入信號(hào)頻率為 f0 ,分兩路,一路經(jīng)過(guò)低位鎖相環(huán)再經(jīng)過(guò)分頻器 N ,輸出頻率變?yōu)?N1f0/N ,相應(yīng)頻率分辨率為 fo/N ,另一路經(jīng)過(guò)高位鎖相環(huán),輸出頻率變?yōu)?N2f0,相應(yīng)頻率分辨率為 f0 ,這兩路的輸出信號(hào)再由鎖相環(huán)路實(shí)現(xiàn)相加輸出信號(hào) f1,總體的頻率分辨率為 f0/N ,即: f1=(N2+N1/N)?f0。

綜合來(lái)看,為了實(shí)現(xiàn)高頻率分辨率的目標(biāo),此種方案也會(huì)存在由于電路復(fù)雜導(dǎo)致的相位噪聲和諧波惡化的問(wèn)題。

DDS 激勵(lì)鎖相環(huán)的系統(tǒng)框架如下圖:

059f9f4a-3220-11f0-afc8-92fbcf53809c.jpg

系統(tǒng)的總體輸出信號(hào)頻率表示為式: f1=N?fDDS=N?MK?f0

其中直接數(shù)字頻率合成中的頻率控制字表示為 K ,相位累加器字長(zhǎng)表示為 M ,此方案有效結(jié)合了兩種技術(shù)的優(yōu)勢(shì),在寬帶高分辨率應(yīng)用方面有重要的作用。

PLL 與 DDS 環(huán)內(nèi)混頻的原理框圖如下圖所示:

05ac4e70-3220-11f0-afc8-92fbcf53809c.jpg

結(jié)構(gòu)方面,是將 DDS 引入基本的鎖相環(huán)路內(nèi),輸出頻率描述為: f1=A?fDDS+N?f0=(A?MK+N)?f0

此方案可以優(yōu)化輸出信號(hào)的相位噪聲參數(shù)并且改善雜散帶來(lái)的干擾(PLL 窄帶濾波特性),但是帶寬較窄并且濾波難度較大。

PLL 與 DDS 環(huán)外混頻的原理框圖如下圖:

05bc38d0-3220-11f0-afc8-92fbcf53809c.jpg

結(jié)構(gòu)方面,核心是 DDS 輸出頻率和 PLL 輸出頻率在外部混頻,頻率分辨率為:(A/M)f0 ,輸出頻率表示為式:f1=A?fDDS±N?f0=(A?MK±N)?f0

此系統(tǒng)方案可以有效提升頻率分辨率,調(diào)頻速度和頻率輸出范圍的性能,但是和環(huán)內(nèi)混頻一樣會(huì)有雜散和濾波難度方面的問(wèn)題。

原文鏈接:https://2048.csdn.net/6825b01ca5baf817cf4c613b.html

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原文標(biāo)題:常見(jiàn)的頻率合成方案匯總

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