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      電子發(fā)燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA入門系列實驗教程之實現(xiàn)數(shù)碼管靜態(tài)顯示的詳細資料說明

      FPGA入門系列實驗教程之實現(xiàn)數(shù)碼管靜態(tài)顯示的詳細資料說明

      2019-06-12 | rar | 0.41 MB | 次下載 | 免費

      資料介紹

      　　1. 實 驗 任 務

      　　實現(xiàn)開發(fā)板上的數(shù)碼管靜態(tài)循環(huán)顯示 0~F。通過這個實驗，掌握采用 VerilogHDL 語言編程實現(xiàn) 7 段數(shù)碼管顯示譯碼器的方法。

      　　2. 實 驗 環(huán) 境

      　　硬件實驗環(huán)境為艾米電子工作室型號 EP2C8Q208C8 增強版開發(fā)套件。軟件實驗環(huán)境為 Quartus II 8.1 開發(fā)軟件。

      　　3. 實 驗 原 理

      　　數(shù)碼管 LED 顯示是工程項目中使用較廣的一種輸出顯示器。常見的數(shù)碼管有共陰和共陽兩種。艾米電子工作室開發(fā)套件上采用的是共陽極數(shù)碼管，共陽數(shù)碼管就是 8 個發(fā)光二極管的陽極連接在一起作為公共端。公共端常稱為位碼，而將其他八位稱為段碼。本實驗先將板載 50M 時鐘源進行 24 次分頻，然后將分頻后的頻率作為四位計數(shù)器的時鐘脈沖信號，使其計數(shù)循環(huán)輸出0~F，最后經 Verilog HDL 編寫的譯碼模塊譯碼后顯示于數(shù)碼管上。

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