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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>射頻無線論文>嵌入式處理器的TLB電路設(shè)計

      嵌入式處理器的TLB電路設(shè)計

      2010-05-12 | rar | 189 | 次下載 | 3積分

      資料介紹

      摘要：為了提高基于虛擬存儲技術(shù)的嵌入式處理器的性能，本文提出了一種用于高效加速地址轉(zhuǎn)換的TLB電路結(jié)構(gòu)該電路采用64-entries的全關(guān)聯(lián)結(jié)構(gòu)，硬件支持基于段及不同大小頁的轉(zhuǎn)換方式，通過VCS和Nanosim聯(lián)合仿真對電路結(jié)構(gòu)和性能進行了驗證，仿真結(jié)果表明，系統(tǒng)中加入TLB電路以后性能有顯著的提高
      關(guān)鍵詞：嵌入式處理器；TLB；VCS；地址轉(zhuǎn)換
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