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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>嵌入式技術(shù)論文>一種可進(jìn)化IP 核的設(shè)計(jì)和實(shí)現(xiàn)

      一種可進(jìn)化IP 核的設(shè)計(jì)和實(shí)現(xiàn)

      2009-05-16 | rar | 222 | 次下載 | 3積分

      資料介紹

      提出一種可進(jìn)化IP 核的設(shè)計(jì)和實(shí)現(xiàn)方法。這種IP 核采用進(jìn)化硬件的設(shè)計(jì)思想， 將遺傳算法運(yùn)用于硬件電路的設(shè)計(jì)中，使電路能根據(jù)當(dāng)前的環(huán)境自動(dòng)進(jìn)行內(nèi)部電路的進(jìn)化，從而生成最有效的電路， 并能在普通的FPGA 器件上實(shí)現(xiàn)?？蛇M(jìn)化IP 核以HDL 源代碼的形式表示，與普通IP 核的復(fù)用方式相同，可被綜合到不同的目標(biāo)可重構(gòu)器件中去，大大減少了復(fù)雜系統(tǒng)的設(shè)計(jì)時(shí)間，提高了設(shè)計(jì)的利用率， 是可進(jìn)化硬件一個(gè)頗具潛力的發(fā)展方向。
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