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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>測(cè)試測(cè)量論文>集成電路抗ESD設(shè)計(jì)中的TLP測(cè)試技術(shù)

      集成電路抗ESD設(shè)計(jì)中的TLP測(cè)試技術(shù)

      2010-04-29 | rar | 124 | 次下載 | 5積分

      資料介紹

      摘要：介紹了一種研究器件和電路結(jié)構(gòu)在EsD期間新的特性測(cè)試方法—一TLP法，該方法不僅可替代HBM測(cè)試，還能幫助電路設(shè)計(jì)師詳細(xì)地分析器件和結(jié)構(gòu)在ESD過(guò)程中的運(yùn)行機(jī)制，有目的地進(jìn)行器件ESD保護(hù)電路的設(shè)計(jì)，提高器件的抗ESD水平。
      關(guān)鍵詞：靜電放電；傳輸線脈沖；測(cè)試技術(shù)；人體模型
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