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標簽 > 數(shù)字電路
用數(shù)字信號完成對數(shù)字量進行算術運算和邏輯運算的電路稱為數(shù)字電路,或數(shù)字系統(tǒng)。由于它具有邏輯運算和邏輯處理功能,所以又稱數(shù)字邏輯電路?,F(xiàn)代的數(shù)字電路由半導體工藝制成的若干數(shù)字集成器件構造而成。
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高速數(shù)字系統(tǒng)設計成功的關鍵在于保持信號的完整,而影響信號完整性(即信號質量)的因素主要有傳輸線的長度、電阻匹配及電磁干擾、串擾等。
2017-04-26 標簽:數(shù)字電路 1980 0
通過本文可以了解時鐘信號的數(shù)字定時以及諸如抖動、漂移、上升時間、下降時間、穩(wěn)定時間、遲滯和眼圖等常用術語。 本教程是儀器基礎教程系列的一部分。
2017-04-26 標簽:數(shù)字電路 2981 0
大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享(4)
當你需要將FPGA/CPLD內(nèi)部的信號通過管腳輸出給外部相關器件的時候,如果不影響功能最好是將這些信號通過用時鐘鎖存后輸出。因為通常情況下一個板子是工作...
大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享(3)
注意:當使用多級非門的時候綜合器往往會將其優(yōu)化掉,因為綜合器會認為一個信號非兩次還是它自己。 需要說明的是在FPGA/CPLD內(nèi)部結構是一種標準的宏單元...
大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享(2)
異步設計不是總能滿足(它們所饋送的觸發(fā)器的)建立和保持時間的要求。因此,異步輸入常常會把錯誤的數(shù)據(jù)鎖存到觸發(fā)器,或者使觸發(fā)器進入亞穩(wěn)定的狀態(tài),在該狀態(tài)下...
大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享(1)
在數(shù)字電路的設計中,時序設計是一個系統(tǒng)性能的主要標志,在高層次設計方法中,對時序控制的抽象度也相應提高,因此在設計中較難把握,但在理解RTL電路時序模型...
建立時間(setuptime)是指在觸發(fā)器的時鐘信號上升沿到來以前,數(shù)據(jù)穩(wěn)定不變的時間,如果建立時間不夠,數(shù)據(jù)將不能在這個時鐘上升沿被打入觸發(fā)器...
如何學好FPGA呢,很多人很困惑,多數(shù)停留在基礎位置徘徊,我就這方面問題給大家談幾點自己的看法。
數(shù)字電路是實現(xiàn)一定邏輯功能的電路,稱為邏輯電路,又稱為開關電路。這種電路中的晶體管一般都工作在開關狀態(tài)。數(shù)字電路可以由分立元件構成(如反相器、自激多諧振...
要看懂數(shù)字電路圖,首先應掌握一些數(shù)字電路的基本知識;其次是了解二進制邏輯單元的各種邏輯符號及輸出、輸入關系;然后還應掌握一些邏輯代數(shù)的知識。具備了這些基...
2016-11-16 標簽:數(shù)字電路 1.7萬 0
在高速PCB的設計過程中,布線是技巧最細、限定最高的,工程師在這個過程中往往會面臨各種問題。本文將首先對PCB做一個基礎的介紹,同時對布線的原則做一個簡...
相近又有所區(qū)別,解析射頻和數(shù)字電路設計的差異
就高速數(shù)字電路而言,雖然電壓還是重點關注對象,但是其設計方法和射頻電路的設計方法相近,也需要考慮阻抗阻抗匹配,因為反射電壓的存在會導致額外的誤碼率。
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