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• 求一種超低成本FPGA JTAG方案

  首先按照GitHub 說明在虛擬機上安裝依賴項，然后創(chuàng)建一個新的存儲庫目錄并克隆了 pico-SDK 和 XVC-Pico 項目。...

  653次閱讀 · 0評論 Linux系統(tǒng)JTAG虛擬機FPGA開發(fā)板rpi
  

• 基于FPGA開發(fā)板的OV7670 驅(qū)動設(shè)計

  在一些攝像頭中，pwdn管腳和rst管腳有時會直接省略掉。pwdn管腳為電源掉電模式管腳，低電平表示為正常模式，高電平表示掉電模式。使用時，將pwdn管腳置為低電平即可。...

  1037次閱讀 · 0評論 fpga寄存器圖像傳感器攝像頭驅(qū)動設(shè)計
  

• 怎么去設(shè)計一種基于FPGA的多通道頻率檢測儀？

  在數(shù)字接收機的各種參數(shù)中，頻率是重要的參數(shù)之一，它能反映接收機的功能和用途、以及頻譜寬度等重要指標(biāo)。...

  1078次閱讀 · 0評論 FPGA設(shè)計數(shù)字濾波器多相濾波器頻率檢測器DFT算法
  

• 關(guān)于FPGA專用時鐘管腳的應(yīng)用

  本文主要用來隨意記錄一下最近在為手頭的FPGA項目做約束文件時候遇到的一點關(guān)于FPGA專用時鐘管腳相關(guān)的內(nèi)容，意在梳理思路、保存學(xué)習(xí)結(jié)果、以供自己日后以及他人參考。...

  3252次閱讀 · 0評論 fpgaXilinxMDIO時鐘信號
  

• Xilinx 7系列FPGA Multiboot介紹

  在遠(yuǎn)程更新的時候，有時候需要雙鏡像來保護設(shè)計的穩(wěn)定性。在進行更新設(shè)計的時候，只更新一個鏡像，另一個鏡像在部署之前就測試過沒問題并不再更新。當(dāng)更新出錯時，通過不被更新的鏡像進行一些操作，可以將更新失敗的數(shù)據(jù)重新寫入Flash。這樣即使更新出錯，也能保證設(shè)計至少可以被遠(yuǎn)程恢復(fù)。...

  1342次閱讀 · 0評論 fpgaFlaShXilinxJTAG鏡像
  

• 異步FIFO原理及使用

  由Binary Pointer生成Gary Pointer，其實這里根據(jù)經(jīng)典AFIFO論文[1]里應(yīng)該是用新的wptr_bin_next生成wptr_gray_next，這樣wptr_bin和wptr_gray可以同步更新。...

  646次閱讀 · 0評論 二進制fifoPointer
  

• 常見的時鐘產(chǎn)生電路有哪些 PLL/DLL電路的優(yōu)缺點

  雙沿時鐘使得原本一個周期輸出/輸入一個數(shù)據(jù)的架構(gòu)，改變?yōu)橐粋€周期輸出/輸入兩個數(shù)據(jù)，這樣在不升高時鐘頻率的前提下，提升了信號的吞吐率，從而帶來「性能的提升」。...

  6749次閱讀 · 0評論 fpga振蕩器寄存器晶體振蕩器數(shù)字設(shè)計
  

• fpga實現(xiàn)加法和減法運算的方法是什么

  FPGA實現(xiàn)加法和減法運算非常簡單，實現(xiàn)乘法和除法可以用IP，那實現(xiàn)對數(shù)和指數(shù)運算該用什么呢？...

  1888次閱讀 · 0評論 fpgamatlab浮點數(shù)
  

• 簡單了解FPGA可重構(gòu)技術(shù)

  FPGA可重構(gòu)技術(shù)就是通過上位機控制在FPGA運行過程中加載不同的Bitstream文件，F(xiàn)PGA芯片根據(jù)文件內(nèi)的不同邏輯將內(nèi)部的資源全部或部分進行重新配置以達(dá)到多種功能任務(wù)動態(tài)切換的目標(biāo)，從而提高了使用FPGA進行開發(fā)的靈活度。...

  909次閱讀 · 0評論 fpga芯片上位機可重構(gòu)技術(shù)

• FPGA零基礎(chǔ)學(xué)習(xí)之TLC5620驅(qū)動教程

  在FPGA處理完數(shù)字信號之后，我們有些情況下是需要將數(shù)字信號轉(zhuǎn)變?yōu)槟M信號再輸出的。比如音頻信號在濾波后，需要轉(zhuǎn)換為聲音信號進行輸出。...

  1171次閱讀 · 0評論 示波器FPGA設(shè)計鎖存器數(shù)模轉(zhuǎn)換器TLC5620
  

• FPGA實現(xiàn)OFDM通信——FFT與IFFT應(yīng)用實現(xiàn)

  HLS需要bit-reverse命令數(shù)據(jù)塊后端,所說的自然順序和一個O (N)轉(zhuǎn)換適用于FFT輸出提取的頻譜數(shù)據(jù)N-point真實數(shù)據(jù)集。注意,第一個輸出兩包第0個和512(純粹的)分別輸出頻譜數(shù)據(jù)的實部和虛部。...

  2420次閱讀 · 0評論 fpgaofdmFFTC語言IFFT
  

• FPGA設(shè)計攔路虎之亞穩(wěn)態(tài)度決定一切

  亞穩(wěn)態(tài)這種現(xiàn)象是不可避免的，哪怕是在同步電路中也有概率出現(xiàn)，所以作為設(shè)計人員，我們能做的是減少亞穩(wěn)態(tài)發(fā)生的概率。...

  538次閱讀 · 0評論 fpgaFPGA設(shè)計MTBF觸發(fā)器亞穩(wěn)態(tài)同步電路
  

• 開源大數(shù)據(jù)OLAP的演化過程和最佳實踐

  首先是對 SQL 的支持，比如是否支持 IC SQL，還是會違背 IC SQL 的語法，有很多自己的 SQL 語法。引申就是有沒有一些 MySQL 協(xié)議或者是 PG 協(xié)議，直接可以去對接更好的 BI 工具，能夠較少地去改動。...

  890次閱讀 · 0評論 SQLOLAPLambda
  

• 什么是三態(tài)電路？在FPGA上如何使用三態(tài)電路作為IO呢？

  一般來說，我們認(rèn)為CMOS數(shù)字電路的輸出的穩(wěn)定狀態(tài)只有2種，就是邏輯0和邏輯1，從模擬信號量來說，就是0V和VDD。...

  5425次閱讀 · 0評論 fpga反相器仿真器三態(tài)電路CMOS數(shù)字電路NMOS管
  

• FPGA設(shè)計的10個實用技巧

  FPGA 設(shè)計工程師需要對如何創(chuàng)建系統(tǒng)以及使用行業(yè)軟件和工具有深入的了解。在軟件方面，設(shè)計工程師必須知道如何建模自己的設(shè)計，并通過一系列測試保證正確的運行。業(yè)界有許多這種高級建模程序，包括Matlab，Simulink，Octave，Verdi等等。...

  694次閱讀 · 0評論 fpga可編程門陣列

• 一種基于FPGA實現(xiàn)的800G信號處理平臺設(shè)計

  一種基于FPGA 實現(xiàn)的800G信號處理平臺...

  602次閱讀 · 0評論 fpgaFPGA設(shè)計寄存器信號處理器虛擬機調(diào)控器
  

• FPGA設(shè)計中flash讀寫工作原理解析

  真實數(shù)據(jù)是保存在較長的一行。分析后可以看到較長行的長度都是一樣的。具體內(nèi)容是，前端若干位是控制符（包含地址），然后是具體數(shù)據(jù)，之后是校驗碼。找到規(guī)律后，就可以直接提取其中內(nèi)容了。...

  2484次閱讀 · 0評論 fpgaFlaShXilinxAltera
  

• 怎么去設(shè)計一種基于FPGA的擴頻模塊呢？

  擴頻系統(tǒng)最早可以追溯到20世紀(jì)20年代左右，擴頻通信就有了初步的應(yīng)用。但是一直到20世紀(jì)年代中期，擴頻系統(tǒng)才真正應(yīng)用和發(fā)展起來。...

  837次閱讀 · 0評論 fpgaFPGA設(shè)計接收機存儲FIFO存儲頻譜儀擴頻模塊
  

• FPGA圖像處理-Sobel邊緣檢測原理

  因為在做3*3卷積的時候，圖像大小會變小，具體計算公式如下...

  995次閱讀 · 0評論 fpga仿真器圖像處理器pythonHDL語言
  

• FPGA時序Bug分析

  Bug的現(xiàn)象是這樣的，假設(shè)我們跑一次test，結(jié)果正確為T，結(jié)果不正確為F。...

  584次閱讀 · 0評論 fpgaFPGA設(shè)計fpga時序TCP通信
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