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ic設(shè)計(jì)

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IC設(shè)計(jì)，Integrated Circuit Design，或稱為集成電路設(shè)計(jì)，是電子工程學(xué)和計(jì)算機(jī)工程學(xué)的一個(gè)學(xué)科，其主要內(nèi)容是運(yùn)用專業(yè)的邏輯和電路設(shè)計(jì)技術(shù)設(shè)計(jì)集成電路。

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ic設(shè)計(jì)技術(shù)

IC設(shè)計(jì)中的多時(shí)鐘域處理方法總結(jié)

我們?cè)贏SIC或FPGA系統(tǒng)設(shè)計(jì)中，常常會(huì)遇到需要在多個(gè)時(shí)鐘域下交互傳輸?shù)膯栴}，時(shí)序問題也隨著系統(tǒng)越復(fù)雜而變得更為嚴(yán)重。

2023-04-06 標(biāo)簽：fpga asic 存儲(chǔ)器 1140 0

自啟動(dòng)可能很難實(shí)現(xiàn) - 了解穩(wěn)壓器和帶隙中的上電復(fù)位要求

電源排序是一個(gè)需要大量解釋的主題。多年前，當(dāng)三端線性穩(wěn)壓器上市時(shí)，在具有正負(fù)電源軌的系統(tǒng)中發(fā)現(xiàn)了一個(gè)缺陷。如果相反的電壓軌首先出現(xiàn)，穩(wěn)壓器輸出將被拉向相...

2023-06-10 標(biāo)簽：電源穩(wěn)壓器 IC設(shè)計(jì) 1125 0

IC驗(yàn)證中的打包思想簡(jiǎn)析

System Verilog（SV）語言的Class本身就帶有“打包”的基因。眾所周知，SV語言的很多特性是派生自C++語言的。

2023-03-15 標(biāo)簽：IC設(shè)計(jì)Verilog C++語言 1124 0

光子集成電路的建模改進(jìn)

首先，一些背景：與IC設(shè)計(jì)中使用的典型電信號(hào)相比，光子信號(hào)相當(dāng)復(fù)雜。光子信號(hào)可以以幅度、相位、偏振和空間模式傳輸信息。此外，使用多個(gè)波長(zhǎng)的光將許多信號(hào)多...

2023-05-24 標(biāo)簽：半導(dǎo)體濾波器 IC設(shè)計(jì) 1123 0

IC設(shè)計(jì)中Linux shell的選擇和使用

你很可能正在使用bash，也可能是csh。你可能聽說過sh、tcsh。如果你安裝過EDA，就知道某EDA要正常工作必須要裝ksh。另外你可能還聽某大神安...

2023-10-31 標(biāo)簽：IC設(shè)計(jì)Linux Shell 1117 0

四種IC封裝設(shè)計(jì)的特點(diǎn)與用途

DIP是很多中小規(guī)模集成電路喜歡采用的封裝形式，其引腳數(shù)一般不超過100個(gè)。采用DIP封裝的CPU芯片有兩排引腳，在使用時(shí)，需要插入到具有DIP結(jié)構(gòu)的芯...

2023-11-17 標(biāo)簽：IC設(shè)計(jì)IC測(cè)試芯片制造 1115 0

華大九天物理驗(yàn)證EDA工具Empyrean Argus助力芯片設(shè)計(jì)

在芯片設(shè)計(jì)的流片之路充滿挑戰(zhàn)，物理驗(yàn)證EDA工具無疑是這“最后一公里”關(guān)鍵且不可或缺的利器。它通過設(shè)計(jì)規(guī)則檢查、版圖與原理圖一致性驗(yàn)證等關(guān)鍵流程，為IC...

2025-07-03 標(biāo)簽：IC設(shè)計(jì)芯片設(shè)計(jì)eda 1109 0

跨導(dǎo)放大器噪聲分析

隨著大規(guī)模復(fù)雜集成電路的不斷發(fā)展，噪聲對(duì)于集成電路性能的潛在危害越來越大。

2023-07-05 標(biāo)簽：MOSFET IC設(shè)計(jì)跨導(dǎo)放大器 1097 0

IC設(shè)計(jì)高手的成長(zhǎng)之路

首先，作為初學(xué)者，需要了解的是IC設(shè)計(jì)的基本流程，這里就斗膽跳過基本電子知識(shí)的方面，單就一些特別的地方來表達(dá)一下個(gè)體的感受。

2012-01-10 標(biāo)簽：IC設(shè)計(jì) 1064 0

全面解析***結(jié)構(gòu)及工作原理

光刻與光刻機(jī) ?對(duì)準(zhǔn)和曝光在光刻機(jī)(Lithography Tool)內(nèi)進(jìn)行。 ?其它工藝在涂膠顯影機(jī)(Track)上進(jìn)行。光刻機(jī)結(jié)...

2023-12-19 標(biāo)簽：控制系統(tǒng)IC設(shè)計(jì)測(cè)量系統(tǒng) 1045 0

一種使用fifo節(jié)約資源降低功耗的設(shè)計(jì)方法

本案例中，我們講解一種使用fifo節(jié)約資源，降低功耗的設(shè)計(jì)。

2023-12-15 標(biāo)簽：IC設(shè)計(jì)RAM FIFO設(shè)計(jì) 1034 0

淺談Cadence模擬IC設(shè)計(jì)流程

大家是否想過，我們的智能手機(jī)為何能夠拍攝出令人驚嘆的照片、播放清晰悅耳的音樂或是準(zhǔn)確測(cè)量心率？

2025-06-23 標(biāo)簽：模擬IC IC設(shè)計(jì)Cadence 1033 0

深入了解FET輸入放大器中的電流噪聲

IC設(shè)計(jì)工程師和電路設(shè)計(jì)人員都深知電流噪聲會(huì)隨頻率增高而變大，但由于關(guān)于此領(lǐng)域的資料過少，或者制造商提供的信息不全，許多工程師很難了解其原因。許多半導(dǎo)體...

2024-02-24 標(biāo)簽：放大器 IC設(shè)計(jì)FET 1024 0

IC設(shè)計(jì)與方法

Quarus Ⅱ工具的整體編譯過程包括邏輯綜合、布局布線、時(shí)序分析、I/O分析（個(gè)人理解芯片引腳的分析）等編譯子過程。

2022-08-16 標(biāo)簽：IC設(shè)計(jì)編譯可編程芯片 1024 0

IC設(shè)計(jì)知識(shí)點(diǎn)：常見的自恢復(fù)設(shè)計(jì)

在芯片設(shè)計(jì)過程中，通常會(huì)針對(duì)特殊情況導(dǎo)致芯片無法使用額外添加一些功能，使得芯片具有更好的抗干擾能力。自恢復(fù)設(shè)計(jì)應(yīng)用場(chǎng)景很廣泛，比如、針對(duì)芯片溫度過高的處...

2023-07-26 標(biāo)簽：芯片 cpu IC設(shè)計(jì) 1005 0

FIFO的深度應(yīng)該怎么計(jì)算

FIFO是FPGA/IC設(shè)計(jì)中經(jīng)常使用到的模塊，它經(jīng)常被用在兩個(gè)模塊之間進(jìn)行數(shù)據(jù)的緩存，以避免數(shù)據(jù)在傳輸過程中丟失。同時(shí)FIFO也經(jīng)常被用在跨時(shí)鐘域處理中。

2024-10-25 標(biāo)簽：FPGA IC設(shè)計(jì)fifo 1001 0

一種常見的解耦設(shè)計(jì)

在模塊劃分時(shí)，我們通常會(huì)考慮解耦合，即盡量減少模塊間的交互，讓模塊間的接口盡量簡(jiǎn)單。

2024-01-17 標(biāo)簽：接口 IC設(shè)計(jì)RAM 994 0

寄存器寫保護(hù)的需求和硬件實(shí)現(xiàn)

在軟件硬件交互的過程中，通常需要軟件（host）對(duì)特定地址的寄存器進(jìn)行寫操作，告之硬件進(jìn)行特定的處理流程，我們?cè)凇禝C設(shè)計(jì)：軟硬件交互-polling》...

2023-10-17 標(biāo)簽：寄存器 IC設(shè)計(jì)硬件 993 0

華大九天版圖寄生參數(shù)分析工具Empyrean ADA介紹

在集成電路設(shè)計(jì)中，寄生參數(shù)是決定芯片性能的關(guān)鍵因素之一，尤其是在先進(jìn)工藝節(jié)點(diǎn)下，其影響愈發(fā)顯著，甚至可能成為影響芯片成敗的決定性因素。

2025-04-19 標(biāo)簽：芯片集成電路 IC設(shè)計(jì) 980 0

狀態(tài)機(jī)的相關(guān)知識(shí)以及C語言編程技能

今天繼續(xù)為大家解析聯(lián)發(fā)科技數(shù)字IC設(shè)計(jì)崗的筆試題。

2022-09-07 標(biāo)簽：IC設(shè)計(jì)C語言狀態(tài)機(jī) 962 0

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